台積電正將半導體先進封裝帶入新世代，其中 CoPoS（Chip-on-Panel-on-Substrate） 與 SoIC（System-on-Integrated-Chips） 是兩大核心技術。
CoPoS 利用方形面板取代傳統矽晶圓，提升產能與成本效率；SoIC 則透過 3D 垂直堆疊，實現異質晶粒整合與效能大幅提升。
隨著台積電在嘉義與美國亞利桑那設廠，測試、濕製程、光學檢測及材料供應商皆有望受惠。
然而，技術量產時程仍在 2027 年以後，投資人需關注良率、產能與供應鏈實際營收貢獻，才能抓住半導體先進封裝的投資機會。
一、CoPoS 是什麼？（Chip-on-Panel-on-Substrate）
- 定位：
台積電開發中的面板級先進封裝。在 CoWoS 的 2.5D 架構上，以方形面板取代圓形晶圓作為載具，結合 CoWoS + FOPLP 的優勢。
- 特性：
支援 300–700 mm 大尺寸面板（manz.com.tw），可放更多晶粒、減少邊角浪費，對 AI 加速器、HPC、HBM 這類大封裝面積產品特別關鍵。
- 目標效益：
相較傳統 CoWoS，提升產能效率、攤薄成本（面板更大、單位產出更多）。
- 時程：
技術仍在開發；量產預估 2027–2028 年
二、SoIC 是什麼？（System-on-Integrated-Chips）
- 定位：
台積電 3DFabric 平台的真 3D 封裝，透過異質晶粒垂直堆疊，做出超高密度的垂直連結。
- 關鍵指標：
晶粒接合 bonding pitch < 10 µm，顯著降低 R/L/C，縮短訊號路徑、提升頻寬、降低功耗。
- 整合能力：
可整合不同工藝節點／不同功能 chiplet，外觀看似單一 SoC，內部為多晶粒垂直堆疊。
- 適用場景：
HPC／AI／高速記憶體與對延遲敏感的工作負載。
三、 CoPoS 與 SoIC 概念股與供應鏈
台灣／全球供應鏈
| 公司（代碼） | 角色與可能受惠點 |
|---|---|
| 台積電（2330） | CoPoS/SoIC 的技術推動者與產能主體；整合 CoWoS 與面板級封裝，並於 嘉義 AP7／美國亞利桑那規劃先進封裝產線 |
| 致茂（2360） | 面板級光學檢測、材料沉積與量測等測試設備 |
| 辛耘（3583） | 濕製程設備（清洗、蝕刻、化學沉積），應用於先進封裝 |
| 志聖（2467） | 塗布／曝光／真空貼合設備，切入面板級封裝 |
| 群翊（3481） | FOPLP 面板級封裝模具／設備，方向與 CoPoS 相呼應 |
| 采鈺（6789） | 黏著／貼合材料，支援多晶粒在大基板上組合 |
| 欣興（3037）／南電（8046） | 高階載板（ABF/BT） 供應商，隨 AI 封裝需求受益 |
| AMAT／LRCX／TEL／KLAC／Disco | 國際關鍵設備（製程、量測、切割）供應商，可能參與 CoPoS/SoIC 線體 |
供應鏈實際訂單需觀察：台積電資本支出節奏、嘉義/亞利桑那廠進度、客戶平台導入時程。
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五、技術比較（CoPoS vs. CoWoS vs. FOPLP vs. SoIC）
| 維度 | CoPoS | CoWoS（2.5D） | FOPLP | SoIC（3D） |
|---|---|---|---|---|
| 載具 | 方形面板（300–700 mm） | 圓形矽晶圓 | 面板級（扇出） | 晶粒垂直堆疊 |
| 連結 | 中介層（2.5D） | 中介層（2.5D） | 重配線（RDL） | 超高密度垂直互連 |
| 目的 | 放更多晶粒、提升面積利用，增產降本 | 成熟 2.5D 大封裝 | 低成本、大面板 | 縮最短路徑、提升效能/效率 |
| 典型應用 | AI/HPC、HBM 大封裝 | AI/HPC、HBM | 中高階封裝、消費性 | HPC/AI、記憶體近置（近存） |
| 量產成熟度 | 開發中（預估 2027–2028） | 量產 | 量產 | 量產中、持續擴充 |
CoPoS 目標解決 CoWoS 產能瓶頸（大面積、產出效率），SoIC 則針對效能/功耗/路徑極致化。
六、投資人應注意什麼？
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技術成熟與量產時程
CoPoS 尚在研發期，市場多以 2027–2028 為量產窗口；SoIC 雖已量產，但良率/成本曲線仍是觀察重點。
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CapEx 與拉貨節奏
受惠公司多為設備/材料商，營收對單一大客戶與投片時序高度敏感。
-
競爭與替代
三星、Intel 亦押注 FOPLP/3D 封裝；若他們採自建產能或不同工法，台灣鏈的訂單可見度可能分散。
-
估值與本業結構
題材熱度高、短線波動大；需辨識公司實際營收貢獻是否來自先進封裝，而非僅止於消息面。
七、常見問答（FAQ）
Q1：CoPoS 與 CoWoS 的本質差異？
A：CoPoS 是 面板級（方形載具）的大面積 2.5D 封裝；CoWoS 是 圓形晶圓上的 2.5D 封裝。CoPoS 著重產能/成本/面積效率，CoWoS 是現今主流量產解。
Q2：SoIC 一定取代 CoWoS 嗎？
A：不一定。SoIC（3D） 對效能/功耗/延遲敏感的負載最有效；CoWoS/CoPoS（2.5D） 對大面積、HBM 近置的組合更具彈性。未來將是「2.5D＋3D 混合」依產品需求並行。
Q3：為何 CoPoS 對 AI/HPC 特別重要？
A：AI 加速器常需多顆 HBM與大面積封裝；面板級可放更多晶粒、減少邊角浪費，用同一產線產出更多單位，提升產能效率。
總結
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CoPoS：以方形面板取代圓晶圓的 2.5D 方案，提升產能與成本效率，預期 2027–2028 年量產。
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SoIC：真 3D 堆疊，bonding pitch < 10 µm，縮短路徑、提頻寬、降功耗，適用 HPC/AI/高速記憶體。
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供應鏈：台積電是推動者；光學檢測、濕製程、塗佈曝光、FOPLP 模具、黏著材料與高階載板等鏈條可望受益（媒體整理）。
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投資檢核：量產時程、良率成本、CapEx 進度、競爭替代與實質營收貢獻，是判斷風險與機會的關鍵。
